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■「論理回路の設計と形式的検証」
 SoCの超微細化と超高集積化にともない、設計検証(Verification)は設計工数の70%を占めるとも言われています。SoC設計はRTL記述手法から、ビヘイビア記述、高位合成への流れにあります。
 

<<講師>>

  浜口 清治 助教授 (大阪大学大学院) 

「論理回路の設計と形式的検証」(1)

第1章 論理関数・論理回路の基礎
第2章 2段組合せ回路の簡単化
第3,4章 多段組合せ回路の簡素化

「論理回路の設計と形式的検証」(2)

第5章 テクノロジマッピング
     FPGA用のテクノロジマッピング
第6章 多段組合せの回路の高速化

「論理回路の設計と形式的検証」(3)

第6章 組合せマージング
第7章 算術演算の基本
第8,9章 浮動小数点演算器 1,2

「論理回路の設計と形式的検証」(4)

第10,11章 算術演算の高速化1,2
第9章(補) 剰余系演算

「論理回路の設計と形式的検証」(5)

第12章 論理回路の設計と形式的検証
第12章(補) 大規模な組合せ回路の検証手法 
第13章 プロパティチェッキング

「論理回路の設計と形式的検証」(6)

第14章 プロパティチェッキング 
第15章 算術演算回路の形式的検証

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